rggen 0.11.0
RgGen is a code generation tool for ASIC/IP/FPGA/RTL engineers. It will automatically generate soruce code related to control/status registers (CSR), e.g. SytemVerilog RTL, UVM RAL model, from human readable register map specifications.
Gemfile:
=
In die Zwischenablage kopieren
Kopiert!
installieren:
=
Runtime Abhängigkeiten (3):
Development Abhängigkeiten (1):
bundler
>= 0
Besitzer:
Pushed by:
Autoren:
-
Taichi Ishitani
SHA 256-Prüfsumme:
2dcc892f3b7e9c1419431299f4989ee3b3d5b0f21e057d738072f0ecdf328b00