origen_verilog 0.6.0

A parser and generator for Verilog (IEEE 1364)

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Versionen:

0.6.3 - September 24, 2019 (117 KB)
0.6.2 - June 12, 2019 (117 KB)
0.6.1 - June 06, 2019 (117 KB)
0.6.0 - May 16, 2019 (117 KB)
0.5.2 - December 20, 2018 (117 KB)

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Runtime Abhängigkeiten (3):

ast ~> 2

origen >= 0.41.0

treetop >= 0

Alle transitiven Abhängigkeiten anzeigen

Besitzer:

Autoren:

Stephen McGinty

SHA 256-Prüfsumme:

9b75b3f1a4b154d8d11af72bc1bc35c56877fdd39251d5a6481d6a906fbaa0fa